檢視可编程阵列逻辑的原始碼

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| style="background: #008080" align= center|  '''<big>可编程阵列逻辑</big> '''
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[[File:D50735fae6cd7b891eb36d820d2442a7d8330ed7.jpg|缩略图|居中|[https://i01piccdn.sogoucdn.com/ae413be0808ed686 原图链接][https://pic.sogou.com/pics?ie=utf8&p=40230504&interV=kKIOkrELjbgQmLkElbYTkKIMkrELjbkRmLkElbkTkKIRmLkEk78TkKILkbHjMz%20PLEDmK6IPjf19z%2F19z6RLzO1H1qR7zOMTMkjYKKIPjflBz%20cGwOVFj%20lGmTbxFE4ElKJ6wu981qR7zOM%3D_844253275&query=%E9%AB%98%E7%A3%81%E5%AF%BC%E7%8E%87%E6%9D%90%E6%96%99 来自搜狗的图片]]]
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'''可编程阵列逻辑'''，英语缩写PAL（programmable array logic)。由可编程的与阵列、固定的或阵列和输出反馈单元组成的一种可编程逻辑器件。PAL器件由可编程的与阵列、固定的或阵列和输出反馈单元组成。
=='''简介'''==
输出和反馈结构由可编程的与阵列和固定的或阵列组成，没有输出反馈信号，输入和输出引出端是固定的，不能由用户自行定义。只适用于简单的组合逻辑电路设计。具有三态输出缓冲器和反馈缓冲器。反馈缓冲器可使三态输出反馈到与阵列输入端，构成简单的触发器，使输出具有记忆功能。用户通过编程可以控制三态输出缓冲器的状态，从而实现对输入/输出引出端数目的任意配置。利用可编程输入/输型PAL器件，可设计编码器、译码器、数据选择器等组合逻辑电路，也可完成串行数据移位和循环等[[操作]]。
=='''评价'''==
有4个乘积项作为专用乘积项，分别控制三态输出[[缓冲器]]、D触发器的时钟、置位和复位，可实现输入/输出端的动态配置和器件中各触发器的异步控制。在或门和D触发器之间增加了一个可编程异或门，其中一个输入端是或门的输出，另一个是可编程异或门输出极性控制端。通过对输出极性控制端编程，可以改变触发器输入信号的极性PAL22V10的宏单元由一个触发器和两个可编程多路选择器组成，通过对两个多路选择器进行编程，每个宏单元可以设置4种输出结构形式和两种反馈信号，因而具有更强的通用性和灵活性。<ref>[https://baijiahao.baidu.com/s?id=1658394265561272290&wfr=spider&for=pc 可编程阵列逻辑]搜狗</ref>
=='''参考文献'''==

[[Category:312 電腦科學]]